基于FPGA的JPEG設計及其在數(shù)字相機系統(tǒng)中的應用.pdf_第1頁
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文檔簡介

1、數(shù)字圖像處理是在計算機圖形學的基礎上發(fā)展而來的，它將模擬信號轉換為了數(shù)字信號，從而提高了圖像傳輸?shù)馁|量。但由于直接轉換得到的圖像數(shù)據(jù)量很大，因此，必須對其進行壓縮。出于對圖像質量和壓縮處理的實時性需求，本文提出了一種新的解決方法，將壓縮標準算法JPEG應用到FPGA芯片設計當中，從而滿足系統(tǒng)的需求。
　　本文利用當前流行的可編程器件FPGA（Field Programmable Gate Array現(xiàn)場可編程邏輯門陣列）實現(xiàn)國際標

2、準的壓縮算法JPEG，將多媒體功能的單獨解決變?yōu)榧薪鉀Q，將模塊體系結構與算法相結合。用硬件描述語言Verilog HDL進行了芯片的設計；充分發(fā)揮了FPGA在并行處理能力和高速計算方面的優(yōu)勢。并結合HDL語言仿真軟件ModelSim進行了仿真，證明了本文研究的可行性和正確性。整個設計分兩個方面：硬件設計和軟件設計。硬件方面從電源設計、PROM配置、去耦電容和時鐘等方面進行了詳細描述；軟件方面從 JPEG壓縮的重點：色彩空間轉換、DCT

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