數(shù)據(jù)存儲測試系統(tǒng)的設計與實現(xiàn).pdf_第1頁
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文檔簡介

1、本文以存儲測試系統(tǒng)宏觀設計原則和系統(tǒng)狀態(tài)設計理論為指導，設計了某導彈數(shù)據(jù)存儲測試系統(tǒng)。該系統(tǒng)主要完成導彈飛行過程中各種信號的采集、編碼和存儲，并能在存儲器半硬回收后通過地面綜合測試系統(tǒng)完成被測數(shù)據(jù)的回收和事后處理。
　　在了解國內外數(shù)據(jù)記錄器的研究現(xiàn)狀和發(fā)展趨勢的基礎上,本文采用可編程邏輯器件FPGA作為主控制芯片，F(xiàn)LASH作為存儲介質的方案，提高了系統(tǒng)的靈活性、可靠性，同時存儲器采用綜合防護技術，增加了存儲器的抗過載能力。地面

2、綜合測試臺內部采用了LVDS環(huán)網總線技術，有效地提高了系統(tǒng)數(shù)據(jù)傳輸速度。彈上數(shù)據(jù)記錄系統(tǒng)通過120米并行長線傳輸電纜與地面綜合測試臺進行通訊，地面綜合測試臺再通過USB2.0與上位機通訊,從而實現(xiàn)了對彈上記錄器的遠程控制與實時監(jiān)測。
　　本文根據(jù)系統(tǒng)的設計指標要求提出了系統(tǒng)的總體設計方案，分析了系統(tǒng)的組成及功能，從采編器、存儲器和地面綜合測試系統(tǒng)三方面介紹了系統(tǒng)硬件電路和邏輯時序的設計，并對系統(tǒng)實現(xiàn)過程中的關鍵技術進行了詳細論述，

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