eda交通燈課程設(shè)計(jì)_第1頁(yè)
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文檔簡(jiǎn)介

1、<p><b>  EDA技術(shù)實(shí)用教程</b></p><p>  課題名稱(chēng): EDA課程設(shè)計(jì) </p><p>  學(xué) 院: 大數(shù)據(jù)與信息工程學(xué)院 </p><p>  專(zhuān) 業(yè): 通信工程

2、 </p><p>  年 級(jí): 通信121 </p><p>  任課教師: </p><p>  2015 年 5 月 27 日</p><p><b>  前言</b>

3、;</p><p>  伴隨著社會(huì)的發(fā)展以及人類(lèi)生活水平的提高,汽車(chē)的數(shù)量在D的DEA 技術(shù)的發(fā)展和應(yīng)用領(lǐng)域的擴(kuò)大與深入,EDA 技術(shù)在電子信息,通信,自動(dòng),控制及計(jì)算機(jī)應(yīng)用等領(lǐng)域的重要性日益突出。隨著技術(shù)市場(chǎng)與人才市場(chǎng)對(duì)DEA 的不斷的增加,交通的問(wèn)題日益突出,單單依靠人力來(lái)指揮交通已經(jīng)不可行了,所以,設(shè)計(jì)交通燈來(lái)完成這個(gè)需求就顯的越加迫切了.為了確保十字路口的行人和車(chē)輛順利、暢通地通過(guò),往往采用電子控制的交通

4、信號(hào)來(lái)進(jìn)行指揮。以下就是運(yùn)用數(shù)字電子設(shè)計(jì)出的交通燈:其中紅燈亮,表示該條路禁止通行;黃燈亮表示停車(chē);綠燈亮表示允許通行。交通管理器工作流程圖:</p><p><b>  1、設(shè)計(jì)任務(wù)</b></p><p>  設(shè)計(jì)一個(gè)十字路口的交通燈控制系統(tǒng),用實(shí)驗(yàn)平臺(tái)上的LED 發(fā)光二極管顯示車(chē)輛通過(guò)的方向(甲車(chē)道和乙車(chē)道各一組),用數(shù)碼管顯示該方向的亮燈時(shí)間。要求:交通燈按正

5、常狀態(tài)依次點(diǎn)亮紅、黃、綠燈,交警可以根據(jù)路口車(chē)流量的情況分別設(shè)置紅、綠、黃燈持續(xù)點(diǎn)亮的時(shí)間。在紅、綠燈點(diǎn)亮?xí)r,能夠顯示其點(diǎn)亮持續(xù)的時(shí)間。</p><p>  2、題目分析與整體構(gòu)思</p><p>  2.1 交通燈控制器應(yīng)具備的功能</p><p>  設(shè)甲車(chē)道和乙車(chē)道方向的車(chē)流量大致相同,因此紅、黃、綠燈的時(shí)長(zhǎng)也相同,考慮到黃燈的作用是警示已過(guò)停車(chē)線的司機(jī)盡快離

6、開(kāi)路口,而路口總寬度不變, 因此將其固定為5 秒,而紅燈亮的時(shí)間等于綠燈亮的時(shí)間加上黃燈亮的時(shí)間,因此緊對(duì)綠燈點(diǎn)亮?xí)r間進(jìn)行設(shè)置就可以同時(shí)改變紅燈亮的時(shí)間,這里將綠燈所能設(shè)置的最長(zhǎng)時(shí)間設(shè)置為40 秒即(0<t1<40)。同時(shí)用數(shù)碼管正計(jì)時(shí)指示當(dāng)前狀態(tài)(紅、黃、綠)所亮的時(shí)間。</p><p><b>  2.2 實(shí)現(xiàn)方案</b></p><p>  2.2.

7、1 從題目中計(jì)數(shù)值與交通燈的亮滅的關(guān)系如圖(1)所示:圖一</p><p>  2.2.2 交通燈控制器系統(tǒng)框圖如圖2 所示:</p><p><b>  3、硬件電路設(shè)計(jì)</b></p><p>  3.1 分頻器的設(shè)計(jì)</p><p>  分頻器實(shí)現(xiàn)的是將高頻時(shí)鐘信號(hào)轉(zhuǎn)換成低頻的時(shí)鐘信號(hào),用于觸發(fā)控制器和計(jì)數(shù)器。該分

8、頻器實(shí)現(xiàn)的是一千分頻,將一千赫茲的時(shí)鐘信號(hào)分頻成一赫茲的時(shí)鐘信號(hào)。生成的Symbol 文件如圖3 和仿真波形如圖4 所示。</p><p><b>  圖三</b></p><p><b>  圖四</b></p><p>  3.2 控制器的設(shè)計(jì)</p><p>  控制器的作用是根據(jù)計(jì)數(shù)器的計(jì)數(shù)

9、值及t1 的輸入數(shù)據(jù)控制發(fā)光二極管的亮、滅,以及輸出正計(jì)時(shí)數(shù)值給七段數(shù)碼管的分位譯碼電路。本控制器是利用時(shí)鐘沿的下降沿讀取前級(jí)計(jì)數(shù)器的計(jì)數(shù)值,然后作出反應(yīng);生成的實(shí)體模塊如圖5 和仿真波形如圖6所示。</p><p><b>  圖五</b></p><p><b>  圖六</b></p><p>  3.3 計(jì)數(shù)器的設(shè)

10、計(jì)</p><p>  計(jì)數(shù)器1 的計(jì)數(shù)范圍為由t1 引腳輸入。計(jì)到t1 后,下一個(gè)時(shí)鐘沿恢復(fù)到0,開(kāi)始下一輪計(jì)數(shù)。仿真波形如圖當(dāng)t1 取7 時(shí),計(jì)數(shù)器計(jì)數(shù)到7 后清零。實(shí)體模塊如圖7 和仿真波形如圖8。計(jì)數(shù)器2 和計(jì)數(shù)器3 的實(shí)體模塊如圖9 和圖10 所示。</p><p><b>  圖7圖9圖10</b></p><p><b>

11、;  圖8</b></p><p>  3.4 分位譯碼電路的設(shè)計(jì)--1</p><p>  由于控制器輸出的正計(jì)時(shí)數(shù)值可能是1 位或者2 位十進(jìn)制數(shù),因此在七段數(shù)碼管的譯碼電路前要加上分位電路(即將其分成2 個(gè)1 位的十進(jìn)制數(shù),如40 分成4 和0,5分為0 和5)。與控制器一樣,分位電路同樣可以由時(shí)鐘驅(qū)動(dòng),也可以設(shè)計(jì)成純組合邏輯電路。控制器中,引入了寄存器。本電路中分位電路

12、使用組合邏輯電路實(shí)現(xiàn)。生成的實(shí)體模塊如圖11 及仿真波形如圖12。</p><p><b>  圖11</b></p><p><b>  圖12</b></p><p>  3.5 分位譯碼電路的設(shè)計(jì)—2</p><p>  分位譯碼電路2 和分位譯碼電路1 的功能是一樣的,為了區(qū)別兩個(gè)不同的引腳

13、</p><p><b>  圖( 8)</b></p><p><b>  圖(11)</b></p><p><b>  圖(12)</b></p><p>  NumC[3..0]和NumD[3..0]因此再設(shè)計(jì)一個(gè)電路,只是引腳名的名稱(chēng)不同,如圖13。</p>

14、;<p>  3.6 數(shù)碼管驅(qū)動(dòng)的設(shè)計(jì)——綠燈和紅燈驅(qū)動(dòng)</p><p>  要求數(shù)碼管共陽(yáng)極連接(共陽(yáng)極的公共端為低電平時(shí),LED 不亮),在設(shè)計(jì)中為每個(gè)數(shù)碼管都添加了一個(gè)驅(qū)動(dòng)電路,在使用時(shí)通過(guò)調(diào)用模塊來(lái)實(shí)現(xiàn)。本模塊設(shè)計(jì)為時(shí)序邏輯電路,采用下降沿觸發(fā)。實(shí)體模塊如圖14 和仿真波形如圖15。</p><p><b>  圖14</b></p>

15、<p><b>  圖15</b></p><p>  3.7 數(shù)碼管驅(qū)動(dòng)的設(shè)計(jì)——黃燈驅(qū)動(dòng)</p><p>  由于黃燈固定時(shí)間是5 秒,因此變化范圍是0 至5 秒,七段數(shù)碼管只要能顯示0-5 的數(shù)就行了,所以單獨(dú)用一個(gè)數(shù)碼管驅(qū)動(dòng)。實(shí)體模塊如圖16和仿真波形如圖17。</p><p><b>  圖16</b&g

16、t;</p><p><b>  圖17</b></p><p>  3.8 頂層連接及其仿真</p><p>  交通燈控制器的頂層文件連接圖如圖18 和仿真波形如圖19。</p><p><b>  圖18</b></p><p><b>  圖19</b

17、></p><p>  對(duì)圖18 和19 的解釋?zhuān)涸趫D18 中,綠燈計(jì)數(shù)器直接接分位譯碼器1,紅燈計(jì)數(shù)器直接接分位譯碼器2,每個(gè)譯碼器分別接兩個(gè)驅(qū)動(dòng)電路,然后接輸出。左邊5 個(gè)驅(qū)動(dòng)器接的數(shù)碼管顯示的是甲車(chē)道各個(gè)燈亮的時(shí)間,右邊5 個(gè)驅(qū)動(dòng)器接的數(shù)碼管顯示的是乙車(chē)道各個(gè)燈亮的時(shí)間。在19 圖中可以看出甲、乙車(chē)道綠燈亮的時(shí)間加上黃燈亮的時(shí)間等于甲車(chē)道紅燈滅的時(shí)間。同時(shí)我們可以看出該系統(tǒng)滿足我們所需的要求。<

18、/p><p><b>  4、程序設(shè)計(jì)</b></p><p>  4.1 分頻器的設(shè)計(jì)</p><p>  library ieee;</p><p>  use ieee.std_logic_1164.all;</p><p>  entity fredevider is ----------分頻

19、器</p><p><b>  port</b></p><p>  (clkin:in std_logic;</p><p>  clkout:out std_logic);</p><p><b>  end;</b></p><p>  architecture dev

20、ider of fredevider is</p><p>  consta nt N:integer:=499;</p><p>  signa l counter:integer range 0 to N;</p><p><b>  圖( 1</b></p><p>  signa l Clk:std_logic;

21、</p><p><b>  begin</b></p><p>  process(clkin)</p><p><b>  begin</b></p><p>  if rising_ed ge(clkin)then</p><p>  if Counter=N then

22、</p><p>  counter<=0;</p><p>  clk<=not clk;</p><p><b>  else</b></p><p>  counter<=counter+1;</p><p><b>  end if;</b><

23、/p><p><b>  end if;</b></p><p>  end process;</p><p>  clkout<=clk;</p><p><b>  end;</b></p><p>  4.2 控制器的設(shè)計(jì)</p><p>  

24、控制器的作用是根據(jù)計(jì)數(shù)器的計(jì)數(shù)值控制發(fā)光二極管的亮、滅,以及輸出正計(jì)時(shí)數(shù)值給七段譯碼管的分譯碼電路。</p><p>  library ieee;</p><p>  use ieee.std_logic_1164.all;</p><p>  entity control is -----------控制器</p><p>  port

25、(clk :in std_logic;</p><p>  c1,c2,c3:out std_logic; ------計(jì)數(shù)器工作時(shí)能信號(hào),為1 時(shí)計(jì)數(shù)</p><p>  w1,w2,w3:in std_logic; ------計(jì)數(shù)器指示信號(hào),在計(jì)數(shù)過(guò)程中,相應(yīng)的指示信號(hào)為0,計(jì)數(shù)結(jié)束時(shí)為1</p><p>  r1,r2 :out std_logic; ---

26、---分別為甲乙車(chē)道紅燈</p><p>  y1,y2 :out std_logic; -------分別為甲乙車(chē)道黃燈</p><p>  g1,g2 :out std_logic; ------分別為甲乙車(chē)道綠燈</p><p>  reset :in std_logic); -------復(fù)位信號(hào),高電平有效</p><p>  en

27、d control ;</p><p>  architecture a of control is</p><p>  type state_space is (s3,s2,s1,s0) ; -----四種狀態(tài)</p><p>  signa l state : state_space ;</p><p><b>  begin&

28、lt;/b></p><p>  process (clk)</p><p><b>  begin</b></p><p>  if reset='1' then</p><p>  state<=s0; --------復(fù)位時(shí)狀態(tài)為S0</p><p>  else

29、 if (clk'event and clk='1') then -------時(shí)鐘上升沿到來(lái)</p><p>  case state is</p><p><b>  when s0=></b></p><p>  if w1='1' then</p><p>  sta

30、te<=s1;</p><p><b>  end if ;</b></p><p><b>  when s1=></b></p><p>  if w2='1' then</p><p>  state<=s2;</p><p><

31、b>  end if ;</b></p><p><b>  when s2=></b></p><p>  if w3='1' then</p><p>  state<=s3;</p><p><b>  end if ;</b></p>

32、<p><b>  when s3=></b></p><p>  if w2='1' then</p><p>  state<=s0;</p><p><b>  end if ;</b></p><p><b>  end case;<

33、/b></p><p><b>  end if;</b></p><p><b>  end if;</b></p><p>  end process;</p><p>  c1<='1'when state =s0 else '0';</p&g

34、t;<p>  c2<='1'when state =s1 or state =s3 else '0';</p><p>  c3<='1'when state =s2 else '0';</p><p>  r1<='1'when state =s1 or state =s0

35、else '0';</p><p>  y1<='1'when state =s3else '0';</p><p>  g1<='1'when state =s2 else '0';</p><p>  r2<='1'when state =s2 or

36、 state =s3 else '0';</p><p>  y2<='1'when state =s1 else '0';</p><p>  g2<='1'when state =s0 else '0';</p><p><b>  end a ;</b&

37、gt;</p><p>  4.3 計(jì)數(shù)器的設(shè)計(jì)</p><p>  4.3.1 綠燈計(jì)數(shù)器</p><p>  library ieee;</p><p>  use ieee.std_logic_1164.all;</p><p>  entity counter1 is</p><p> 

38、 port (clk :in std_logic;</p><p>  enable :in std_logic;</p><p>  t1 :in integer range 0 to 40 ; -------綠燈可設(shè)置亮的時(shí)間</p><p>  c1 :out std_logic);</p><p>  end counter1 ;&l

39、t;/p><p>  architecture a of counter1 is</p><p><b>  begin</b></p><p>  process (clk)</p><p>  variable cnt : integer range 0 to 40 ; -----變量cnt 定義為常數(shù),取值范圍為0&l

40、t;/p><p><b>  到40</b></p><p><b>  begin</b></p><p>  if (clk'event and clk='1') then -----時(shí)鐘上升沿到來(lái)</p><p>  if enable='1'a nd cn

41、t<t1 then -----使能信號(hào)為1,并且cnt 小于t1 時(shí)</p><p>  cnt:=cnt+1; ------加計(jì)數(shù)</p><p><b>  else</b></p><p><b>  cnt:=0;</b></p><p><b>  end if ;<

42、/b></p><p>  if cnt=t1 then</p><p>  c1<='1'; ---------乙道開(kāi)始通行,S0 狀態(tài)</p><p><b>  else</b></p><p><b>  c1<='0';</b></p

43、><p><b>  end if ;</b></p><p><b>  end if ;</b></p><p>  end process;</p><p><b>  end a ;</b></p><p>  4.3.2 紅燈計(jì)數(shù)器</p&g

44、t;<p>  library ieee;</p><p>  use ieee.std_logic_1164.all;</p><p>  entity counter2 is</p><p>  port (clk :in std_logic;</p><p>  enable :in std_logic;</p>

45、;<p>  t1 :in integer range 0 to 40 ;</p><p>  c2 :out std_logic);</p><p>  end counter2 ;</p><p>  architecture a of counter2 is</p><p>  consta nt y:Integer:=5

46、; ---------黃燈固定時(shí)間為5 秒</p><p>  signa l t2 : integer range 0 to 45; -------紅燈亮的時(shí)間</p><p><b>  begin</b></p><p>  process (clk)</p><p>  variable cnt : intege

47、r range 0 to 45 ; ----------變量cnt 定義為常數(shù),取值范圍為0</p><p><b>  到45</b></p><p><b>  begin</b></p><p><b>  t2<=t1+y;</b></p><p>  if (c

48、lk'event and clk='1') then -------時(shí)鐘上升沿到來(lái)</p><p>  if enable='1'a nd cnt<t2 then -----使能信號(hào)為1,并且cnt 小于t2 時(shí)</p><p>  cnt:=cnt+1;</p><p><b>  else</b>

49、;</p><p><b>  cnt:=0;</b></p><p><b>  end if ;</b></p><p>  if cnt=t2 then</p><p>  c2<='1'; -------工作在S1 或S3 狀態(tài)</p><p>

50、<b>  else</b></p><p><b>  c2<='0';</b></p><p><b>  end if ;</b></p><p><b>  end if ;</b></p><p>  end process

51、;</p><p><b>  end a;</b></p><p>  4.3.3黃燈計(jì)數(shù)器</p><p>  library ieee;</p><p>  use ieee.std_logic_1164.all;</p><p>  entity counter3 is</p>

52、<p>  port (clk :in std_logic;</p><p>  enable :in std_logic;</p><p>  c3 :out std_logic;</p><p>  m3 :out integer range 0 to 5 );</p><p>  end counter3;</p&g

53、t;<p>  architecture a of counter3 is</p><p><b>  begin</b></p><p>  process (clk)</p><p>  variable cnt : integer range 0 to 5 ; -------變量cnt 定義為常數(shù),取值范圍為0</p&

54、gt;<p><b>  到5</b></p><p><b>  begin</b></p><p>  if (clk'event and clk='1') then -----時(shí)鐘上升沿到來(lái)</p><p>  if enable='1'a nd cnt<5

55、 then -----使能信號(hào)為1,并且cnt 小于5 時(shí)</p><p>  cnt:=cnt+1; ------加計(jì)數(shù)</p><p><b>  else</b></p><p><b>  cnt:=0;</b></p><p><b>  end if ;</b>&l

56、t;/p><p>  if cnt=5 then</p><p>  c3<='1'; ---------工作在S2 狀態(tài)</p><p><b>  else</b></p><p><b>  c3<='0';</b></p><p&g

57、t;<b>  end if ;</b></p><p><b>  end if ;</b></p><p><b>  m3<=cnt;</b></p><p>  end process;</p><p><b>  end a ;</b>&l

58、t;/p><p>  4.4 分位譯碼電路設(shè)計(jì)--1</p><p>  LIBRARY IEEE;</p><p>  USE IEEE.STD_LOGIC_1164.ALL;</p><p>  ENTITY Fenwei1 IS</p><p><b>  PORT</b></p>

59、<p>  (Numin:IN integer RANGE 0 TO 45;</p><p>  NumA,NumB:OUT Integer RANGE 0 to 9 -------綠燈亮的時(shí)間,十位和個(gè)位數(shù)字</p><p><b>  );</b></p><p><b>  END;</b></p&

60、gt;<p>  ARCHITECTURE behavior OF Fenwei1 IS</p><p><b>  BEGIN</b></p><p>  process(Numin)</p><p><b>  BEGIN</b></p><p>  IF Numin>=40

61、 THEN -------輸入計(jì)時(shí)數(shù)據(jù)大于40</p><p>  NumA<=4; -------把十位數(shù)字送給A</p><p>  NumB<=Numin-40; -------把個(gè)位數(shù)字送給B</p><p>  ELSIF Numin>=30 THEN</p><p><b>  NumA<=3;&

62、lt;/b></p><p>  NumB<=Numin-30;</p><p>  ELSIF Numin>=20 THEN</p><p><b>  NumA<=2;</b></p><p>  NumB<=Numin-20;</p><p>  ELSIF N

63、umin>=10 THEN</p><p><b>  NumA<=1;</b></p><p>  NumB<=Numin-10;</p><p><b>  ELSE</b></p><p><b>  NumA<=0;</b></p>

64、<p>  NumB<=Numin;</p><p><b>  END IF;</b></p><p>  END PROCESS;</p><p><b>  END;</b></p><p>  4.5 分位譯碼電路的設(shè)計(jì)—2</p><p>  LI

65、BRARY IEEE;</p><p>  USE IEEE.STD_LOGIC_1164.ALL;</p><p>  ENTITY Fenwei2 IS</p><p><b>  PORT</b></p><p>  (Numin:IN integer RANGE 0 TO 45;</p><p

66、>  NumC,NumD:OUT Integer RANGE 0 to 9 -----紅燈亮的時(shí)間,十位和個(gè)位</p><p><b>  );</b></p><p><b>  END;</b></p><p>  ARCHITECTURE behavior OF Fenwei2 IS</p>&l

67、t;p><b>  BEGIN</b></p><p>  process(Numin)</p><p><b>  BEGIN</b></p><p>  IF Numin>=40 THEN</p><p><b>  NumC<=4;</b></p&

68、gt;<p>  NumD<=Numin-40;</p><p>  ELSIF Numin>=30 THEN</p><p><b>  NumC<=3;</b></p><p>  NumD<=Numin-30;</p><p>  ELSIF Numin>=20 THEN

69、</p><p><b>  NumC<=2;</b></p><p>  NumD<=Numin-20;</p><p>  ELSIF Numin>=10 THEN</p><p><b>  NumC<=1;</b></p><p>  NumD

70、<=Numin-10;</p><p><b>  ELSE</b></p><p><b>  NumC<=0;</b></p><p>  NumD<=Numin;</p><p><b>  END IF;</b></p><p>

71、;  END PROCESS;</p><p><b>  END;</b></p><p>  4.6 數(shù)碼管驅(qū)動(dòng)的設(shè)計(jì)</p><p>  4.6.1 紅綠燈驅(qū)動(dòng)</p><p>  LIBRARY IEEE;</p><p>  USE IEEE.STD_LOGIC_1164.ALL;<

72、;/p><p>  ENTITY qudong IS</p><p><b>  PORT</b></p><p>  (clk:in STD_LOGIC;</p><p>  enable :in std_logic;</p><p>  data:IN integer RANGE 0 TO 9;

73、------輸入數(shù)字</p><p>  segout: out STD_LOGIC_VECTOR(6 downto 0)); -------七段顯示器輸出</p><p><b>  END;</b></p><p>  ARCHITECTURE behavior OF qudong IS</p><p><b&

74、gt;  BEGIN</b></p><p>  process(Clk,data)</p><p><b>  BEGIN</b></p><p>  IF falling_edge(Clk) and enable='1' then ------下降沿到來(lái)和使能信號(hào)為1 時(shí)</p><p>

75、  case data is</p><p>  when 0=>segout<="1111110";</p><p>  when 1=>segout<="0110000";</p><p>  when 2=>segout<="1101101";</p>

76、<p>  when 3=>segout<="1111001";</p><p>  when 4=>segout<="0110011";</p><p>  when 5=>segout<="1011011";</p><p>  when 6=>se

77、gout<="0011111";</p><p>  when 7=>segout<="1110000";</p><p>  when 8=>segout<="1111111";</p><p>  when 9=>segout<="1110011&qu

78、ot;;</p><p>  when others =>null;</p><p><b>  END CASE;</b></p><p><b>  END IF;</b></p><p>  END PROCESS;</p><p><b>  END;

79、</b></p><p>  4.6.2 黃燈驅(qū)動(dòng)</p><p>  LIBRARY IEEE;</p><p>  USE IEEE.STD_LOGIC_1164.ALL;</p><p>  ENTITY HDqudong IS ---------黃燈驅(qū)動(dòng)</p><p><b>  POR

80、T</b></p><p>  (clk:in STD_LOGIC;</p><p>  enable :in std_logic;</p><p>  data:IN integer RANGE 0 TO 5; ------黃燈變化范圍</p><p>  segout: out STD_LOGIC_VECTOR(6 downt

81、o 0));</p><p><b>  END;</b></p><p>  ARCHITECTURE behavior OF HDqudong IS</p><p><b>  BEGIN</b></p><p>  process(Clk,data)</p><p>&

82、lt;b>  BEGIN</b></p><p>  IF falling_edge(Clk) and enable='1' then</p><p>  case data is</p><p>  when 0=>segout<="1111110";</p><p>  w

83、hen 1=>segout<="0110000";</p><p>  when 2=>segout<="1101101";</p><p>  when 3=>segout<="1111001";</p><p>  when 4=>segout<=&quo

84、t;0110011";</p><p>  when 5=>segout<="1011011";</p><p>  when others =>null;</p><p><b>  END CASE;</b></p><p><b>  END IF;<

85、/b></p><p>  END PROCESS;</p><p><b>  END;</b></p><p><b>  5﹑硬件測(cè)試</b></p><p>  把頂層文件連接圖進(jìn)行編譯仿真后就可以進(jìn)行硬件測(cè)試了,我們所用的仿真實(shí)驗(yàn)箱是GW48 系列SOPC/EDA 實(shí)驗(yàn)開(kāi)發(fā)系統(tǒng)(杭州

86、康芯電子有限公司現(xiàn)代DSP 實(shí)驗(yàn)開(kāi)發(fā)系統(tǒng))。在實(shí)驗(yàn)箱中因?yàn)橛?HZ 的頻率并且自帶譯碼器,所以在下載時(shí)用的頂層文件連接圖就把分頻器和譯碼器驅(qū)動(dòng)電路給去掉了,如圖(20),在實(shí)驗(yàn)過(guò)程中由于數(shù)碼管不夠,圖中5 個(gè)數(shù)碼管顯示的是一個(gè)車(chē)道的綠、紅、黃燈時(shí)間。</p><p><b>  圖20</b></p><p><b>  6、引腳鎖定</b>&l

87、t;/p><p>  在下載之前,要進(jìn)行引腳的鎖定,我們用的是模式5,各個(gè)端口的引腳鎖定如圖21。 </p><p><b>  圖21</b></p><p>  在確定引腳鎖定正確后再編譯一次,然后下載到實(shí)驗(yàn)箱中。首先對(duì)綠燈時(shí)間t1 進(jìn)行置數(shù),可在0 到40 任意置數(shù),不妨設(shè)為7 秒,然后系統(tǒng)開(kāi)始工作,綠燈從0 開(kāi)始正計(jì)時(shí)到7 再跳到黃燈從

88、0 開(kāi)始正計(jì)時(shí)到5 然后再跳到紅燈從0 開(kāi)始正計(jì)時(shí)到12。相應(yīng)的另一車(chē)道的紅、綠、黃燈會(huì)變化只是沒(méi)有顯示相應(yīng)的時(shí)間。</p><p><b>  7、心得體會(huì)</b></p><p>  EDA 課程設(shè)計(jì),使我對(duì)EDA 的認(rèn)識(shí)有提高了一個(gè)層次,現(xiàn)在能夠熟練的使用QuartsII,能夠用VHDL 語(yǔ)言編寫(xiě)簡(jiǎn)單的、實(shí)用的小程序,這次EDA 課程設(shè)計(jì)重點(diǎn)學(xué)習(xí)了交通燈部分程序

89、的編寫(xiě)、調(diào)試、還有硬件下載、操作等過(guò)程。在整個(gè)課程設(shè)計(jì)的過(guò)程中,我查閱了大量的關(guān)于EDA 的資料,特別是在網(wǎng)上和圖書(shū)館我找到了大量的關(guān)于硬件編程的資料。另外,圖(21)- 22 -在課程設(shè)計(jì)的過(guò)程中我認(rèn)為調(diào)試程序是很重要的,要有耐心。我在第一次編譯時(shí)有三十幾個(gè)錯(cuò)誤,其中有輸入錯(cuò)誤、語(yǔ)法錯(cuò)誤,如:工程名和實(shí)體名不一致,少了分號(hào)或者少了END IF 等錯(cuò)誤。發(fā)現(xiàn)錯(cuò)誤之后就要一遍一遍的仔細(xì)查錯(cuò),直到?jīng)]有錯(cuò)誤,然后可以進(jìn)行波型仿真了。</

90、p><p><b>  8﹑參考文獻(xiàn)</b></p><p> ?。?)潘松,黃繼業(yè).EDA 技術(shù)實(shí)用教程.科學(xué)出版社.2006.9</p><p> ?。?)李輝.PLD 與數(shù)字系統(tǒng)設(shè)計(jì).西安電子科技大學(xué)出版社.2005</p><p> ?。?)蔣璇.臧蠢華.數(shù)字系統(tǒng)設(shè)計(jì)與PLD 應(yīng)用(第二版).電子工業(yè)出 &l

91、t;/p><p><b>  版社.2005</b></p><p>  劉篤仁、楊萬(wàn)海編著.在系統(tǒng)可編程技術(shù)及其器件原理與應(yīng)用. </p><p>  西安:電子科技大學(xué)出版社.2001</p><p>  張?jiān)幹?可編程邏輯器件設(shè)計(jì)及應(yīng)用.北京:機(jī)械工業(yè)出版 </p><p><b>

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